全球領先的嵌入式軟件解決方案供應商IAR正式發布其旗艦產品的重大更新版本：Arm開發工具鏈v9.70和RISC-V開發工具鏈v3.40，大幅提升了IAR開發平臺在性能、安全性和自動化方面的能力，助力汽車、工業、醫療和物聯網等行業中的敏捷、可擴展嵌入式應用。為應對嵌入式系統日益增長的復雜性，全新的IAR開發工具鏈支持云端許可、CI/CD管道集成和多種架構的開發。隨著Arm和RISC-V持續推動技術演進，IAR推出統一的開發平臺，提供高質量且具安全保障的開發體驗。新版本幫助客戶提升研發效率、降低研發成本、縮短
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IAR RISC-V
英國芯片設計公司 Aion Silicon（前身為 Sondrel）贏得了一個 $12m 的項目，用于開發用于高性能計算 （HPC） 和人工智能 （AI） 應用的 RISC-V 加速器。該項目涵蓋了從完整的 RTL 架構和驗證到可測試設計、物理實現和使用 RISC-V 開放指令集架構 （ISA） 和矢量擴展在前沿節點上流片的所有設計工作，以加速 AI 工作負載。Aion 已經從設計服務（例如最近的視頻芯片 ASIC 合同）轉變為提供全方位服務的芯片供應，包括與代工廠合作。它之前曾為“全球 HPC 競賽需要
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Aion Silicon RISC-V AI芯片
提到服務器 CPU 芯片，X86 和 ARM 架構是大眾認知中的「常客」。而最近，隨著一系列熱點事件的發布，基于 RISC-V 架構的服務器 CPU 迅速 「破圈」，闖入大眾視野。RISC-V 服務器 CPU，紛紛亮相RISC-V 架構有著開源、指令精簡和可擴展的優勢，在注重能效比的物聯網領域收獲頗豐。不過，這并不意味著 RISC-V 無法進軍有更高性能要求的 PC 和服務器市場。如今，已有多家公司的 RISC-V 架構服務器 CPU 芯片亮相。玄鐵C930阿里巴巴達摩院旗下品牌玄鐵，
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RISC-V 服務器CPU
芬蘭的 Flow Computing 已開始對其并行處理單元 （PPU） AI 模塊的 RISC-V 編譯器進行 alpha 測試。PPU 能夠通過使用編譯器使源代碼利用該架構，將任何 CPU 架構增加多達 100 倍。第一次目標編譯表明，通過重新編譯現有代碼，可以顯著減少 RISC-V CPU 模型中常見的循環，達到 100 倍的預期性能。相比之下，只需將一些 CPU 內核替換為 PPU，即可在不更改源代碼的情況下進行 2 倍的改進，而無需重新編譯。編譯器識別現有源代碼中可由 PPU 有效加速的并行元素
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并行AI RISC-V 編譯器 Alpha測試
西班牙的 SemiDynamics 開發了一種完全可編程的神經處理單元 （NPU） IP，它結合了 CPU、向量和張量處理，可為大型語言模型和 AI 推薦系統提供高達 256 TOPS 的吞吐量。Cervell NPU 基于 RISC-V 開放指令集架構，可從 8 個內核擴展到 64 個內核。這使設計人員能夠根據應用的要求調整性能，從緊湊型邊緣部署中 1GHz 的 8 TOPS INT8 到數據中心芯片中高端 AI 推理中的 256 TOPS INT4。這是繼 12 月推出的一體化架構之后發布的，本白皮書
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SemiDynamics RISC-V NPU
4月15~17日，沁恒多維度、多層次的USB/Type-C/藍牙/以太網接口芯片和青稞RISC-V系列MCU/SoC亮相2025上海慕尼黑電子展，現場人氣火爆。RISC-V全家桶、Type-C全家桶等特色版塊，工業控制、物聯網、計算機手機周邊等場景專題，9大版面充分詮釋了沁恒對專業RISC-V玩家的定義：技術上一捅到底、產品上百花齊放，應用上互連互通。一捅到底的技術處理器“核”技術是數據處理的關鍵，接口底層PHY“根”技術是信息交換的窗口。秉承由核到芯、由內而外的全棧自研模式，沁恒青稞RISC-V貫穿了內
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RISC-V 沁恒 上海慕展
全球半導體產業競爭日趨激烈，RISC-V（第五代精簡指令集計算機）憑借開源等優勢有望改寫芯片市場競爭格局。隨著國際形勢不斷復雜化，RISC-V為中國在處理器設計領域實現自主可控提供了一條加速路徑。近年，在政策支持、產業投資以及RISC-V架構自身優勢的共同推動下，中國已成為全球RISC-V開發和應用的主要中心，國內RISC-V芯片正加速突圍崛起。RISC-V快速崛起，生態鏈蓬勃發展RISC-V誕生于2010年左右加州大學伯克利分校的一項學術研究，其初衷是創建一種現代、簡潔、可擴展且不受現有架構（如ARM、
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芯片規則 RISC-V
上個月，一個 Google 安全研究人員團隊發布了一個工具，該工具可以修改基于 Zen 微架構的 AMD 處理器的微碼，即 Zentool。雖然這是一個安全漏洞，但對某些人來說，這是一個機會:來自中國某項目組的成員正在舉辦一項競賽，旨在為 AMD 基于 Zen 的現代 CPU 開發微碼，使其能夠本地執行 RISC-V 程序。最終目標可能是使用現有的芯片構建終極 RISC-V CPU。x86 是大約 48 年前開發的復雜指令集計算機 （CISC） 指令集架構 （ISA）。但是，
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AMD Zen處理器 RISC-V 代碼
2025年4月9日——中國數字EDA龍頭企業上海合見工業軟件集團有限公司（簡稱“合見工軟”）與北京開源芯片研究院（簡稱"開芯院"）宣布雙方就“香山”高性能開源RISC-V處理器項目深化技術合作的又一重要成果，依托合見工軟自主研發的全場景驗證硬件系統UniVista Unified Verification Hardware System（UVHS），雙方成功實現“香山”第三代昆明湖架構RISC-V處理器在16核大系統的軟硬件協同實測驗證。此次技術突破顯著提升了處理器的開發驗證效率，為后
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合見工軟 開芯院 RISC-V
對于使用基于 RISC-V 的平臺的開發人員，該架構提供了獨特的功能，可幫助實現功能安全和信息安全目標。例如，從開放式架構到豐富的工具生態系統，安全關鍵型軟件團隊看到了滿足 DO-178C 和 ISO 26262 準則的好處，以及減少合規工作的機會。了解如何將 RISC-V 的模塊化、簡單性和可擴展性與行業標準對應起來可能很困難。本文介紹了開發人員可以利用 RISC-V 實現認證安全關鍵型系統的合規性的七種方式。降低系統復雜性RISC-V 的開放標準指令集架構 （ISA） 與專有架構相
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安全關鍵系統認證 RISC-V
國芯科技(688262.SH)公告稱，公司基于RISC-V架構多核CPU自主研發的超高性能云安全芯片CCP917T新產品于近日在公司內部測試中獲得成功。國芯科技本次內測成功的超高性能云安全芯片CCP917T，擁有超高的算法性能和接口帶寬，為云安全應用場景下的數據處理提供高帶寬、低延遲、快響應支撐。可以廣泛應用于信息安全各個領域：● 需處理大規模加密數據流、虛擬化資源動態分配，以及存儲加密服務的云計算● 超低時延、海量連接場景需高效密碼運算的5G網絡● 需處理高并發交易、
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國芯科技 RISC-V 云安全芯片
今天給大家分享一個耗時又有趣的項目：手搓一個16位RISC架構CPU。項目的起因是，作者在學習了MITx的 "計算結構 "課程后，發現好像自己做一個CPU也沒那么難。在掌握了電子學的初級知識和課程中介紹的概念之后，就開始設計想要做一個基于NMOS邏輯的RISC CPU。課程中介紹的是Beta CPU——有一個負載存儲，32位RISC架構。為了節省空間、晶體管，少掉一點頭發，作者決定把自己的這個CPU減少到16位。注：MITx的"Computation Structures&q
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RISC-V CPU
4月3日消息，2日深夜，復旦大學宣布，復旦大學集成芯片與系統全國重點實驗室周鵬、包文中聯合團隊成功研制全球首款基于二維半導體材料的32位RISC-V架構微處理器“無極（WUJI）”，中國二維半導體芯片取得里程碑式突破。該成果突破二維半導體電子學工程化瓶頸，首次實現5900個晶體管的集成度，是由復旦團隊完成、具有自主知識產權的國產技術，使我國在新一代芯片材料研制中占據先發優勢，為推動電子與計算技術進入新紀元提供有力支撐。相關成果已以《基于二維半導體的RISC-V 32比特微處理器》（“A RISC-V 32
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RISC-V 二位半導體材料
RISC-V 的開放架構使得嵌入式系統能夠采用左移方法來保障安全性。了解它如何為在開發周期早期集成安全功能鋪平道路。隨著連接性的增強，嵌入式系統的安全性集成變得更加復雜，因為連接性帶來了風險和漏洞的機會。RISC-V 架構為在生命周期早期實施“左移”安全開發實踐提供了獨特優勢，從而能夠盡早緩解風險。它允許開發人員在最基礎的層面主動評估、定制和增強安全功能，避免因被動解決安全問題而付出高昂代價。圖 1：RISC-V 為開發過程中的“左移”提供了許多定制化優勢。本文討論了 RISC-V 的一些特性，這些特性為
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RISC-V 嵌入式系統
本文深入探討了雙核鎖步技術在保障汽車芯片安全性中的應用。文章首先分析了國產車規芯片在高安全可靠領域面臨的軟錯誤難點及攻克方向，然后詳細介紹了雙核鎖步技術的基本原理及其在汽車芯片防軟錯誤的重要性。通過對比國內外多家廠商的芯片技術，分析了軟錯誤設計在車身域控制器中的關鍵作用，為汽車芯片的國產化替代提供參考依據。一、引言隨著汽車電子技術的飛速發展，汽車芯片在車輛的智能化、網聯化和電動化進程中扮演著至關重要的角色。汽車車身控制的車身域控制器作為汽車電子控制系統的核心部件之一，其可靠性直接關系到車輛的安全性和舒適性
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RISC-V 架構 雙核鎖步 車身控制器
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