- 摘要：為了使基于FPGA設計的信號處理系統具有更高運行速度和具有更優化的電路版圖布局布線，提出了一種適用于FPGA結構的改進型WALLACE TREE架構乘法器。首先討論了基于標準單元3：2壓縮器的改進型6：4壓縮器，根據FP
- 關鍵字：
WALLACE FPGA TREE 乘法器設計
- 對Booth算法產生的部分積重新合理分組，采用CSA和4-2壓縮器的混合電路結構，對傳統的Wallace樹型乘法器進行改進，提出一種高速的樹型乘法器。
- 關鍵字：
Wallace 乘法器
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