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基于DBL結(jié)構(gòu)的嵌入式64kb SRAM的低功耗設計
- 針對嵌入式系統(tǒng)的低功耗要求，采用位線分割結(jié)構(gòu)和存儲陣列分塊譯碼結(jié)構(gòu)，完成了64 kb低功耗SRAM模塊的設計。 與一般布局的存儲器相比，采用這兩種技術(shù)使存儲器的功耗降低了43% ，而面積僅增加了18%。
- 關鍵字： DBL 嵌入式系統(tǒng) SRAM 低功耗 嵌入式
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