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降低任何嵌入式設計的體積和成本的常用方法是使用具有較少I/O引腳的通信總線。雖然從并行總線發(fā)展到串行總線可明顯減小體積和降低成本，但是從一種串行總線發(fā)展為另一種具有較少引腳的串行總線也很有用。用串行總線替代并行總線時，傳輸速度是一個關(guān)鍵參數(shù)。在小體積是最重要參數(shù)的設計中，使用具有較少引腳的串行總線很有優(yōu)勢。單片機集成超過12種不同的串行接口，本文將討論各串行接口的優(yōu)缺點。
- 降低任何嵌入式設計的體積和成本的常用方法是使用具有較少I/O引腳的通信總線。雖然從并行總線發(fā)展到串行總線可明顯減小體積和降低成本，但是從一種串行總線發(fā)展為另一種具有較少引腳的串行總線也很有用。用串行總線替代并行總線時，傳輸速度是一個關(guān)鍵參數(shù)。在小體積是最重要參數(shù)的設計中，使用具有較少引腳的串行總線很有優(yōu)勢。單片機集成超過12種不同的串行接口，本文將討論各串行接口的優(yōu)缺點。,降低任何嵌入式設計的體積和成本的常用方法是使用具有較少I/O引腳的通信總線。雖然從并行總線發(fā)展到串行總線可明顯減小體積和降低成本，但是
- 關(guān)鍵字： 總線 串行 具有 體積 并行 使用 降低 發(fā)展 接口 參數(shù)
基于SST串行閃存小體積的數(shù)據(jù)采集系統(tǒng)的設計與實現(xiàn)
- 0 引 言
在現(xiàn)代電子測量、儀器儀表、生物醫(yī)學等領(lǐng)域中，經(jīng)常涉及到現(xiàn)場采集模擬信號的工作，在某種情況下由于空間的限制，要求采集電路的體積要非常小。傳統(tǒng)的數(shù)據(jù)采集電路大多采用并行的閃存，體積比較大，不 - 關(guān)鍵字： SST 串行閃存 體積 數(shù)據(jù)采集系統(tǒng)
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