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EEPW首頁 >> 主題列表 >> 平臺設(shè)計

平臺設(shè)計文章最新資訊

一種基于FPGA／DSP的靈巧干擾平臺設(shè)計與實現(xiàn)

引言
目前，通信干擾的手段以信號大功率壓制為主，本質(zhì)上屬于物理層能量干擾，存在效費比低，且容易暴露自身目標(biāo)等缺點，而且隨著新的功率控制和信號處理技術(shù)的應(yīng)用，通信大功率壓制干擾手段的應(yīng)用遇到了瓶頸。
關(guān)鍵字： FPGA DSP 干擾平臺設(shè)計

基于FPGA的可配置通信平臺設(shè)計

本文設(shè)計了一種基于FPGA的、通用可配置的通信開發(fā)與測試平臺。針對不同信道編碼和調(diào)制方式的組合，通過采用實時軟硬件重構(gòu)技術(shù)，該平臺可以在短期內(nèi)完成相應(yīng)通信系統(tǒng)的構(gòu)建、驗證和配置。
關(guān)鍵字： FPGA 可配置通信平臺設(shè)計

基于RVM的層次化SoC芯片驗證平臺設(shè)計及應(yīng)用

本文以SIM卡控制模塊的功能驗證為例，介紹了運用Synopsys Vera驗證工具以及RVM驗證方法學(xué)快速高效地搭建高質(zhì)量驗證平臺的方法。文中詳細介紹了RVM驗證方法學(xué)以及RVM驗證平臺的結(jié)構(gòu)。
關(guān)鍵字： RVM SoC 芯片驗證平臺設(shè)計

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平臺設(shè)計介紹

您好，目前還沒有人創(chuàng)建詞條平臺設(shè)計!
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