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一種基于動態閾值NMOS的1．2V CMOS動態閾值模擬乘法器

作者：時間：2012-01-02 來源：網絡

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體管個數為6，且需要額外的偏置電路。文獻的偏置電路功耗大于CMOS模擬乘法器本身的功耗。在1．5V電源電壓條件下約為70μA。與文獻的仿真設計結果比較，文中輸出信號帶寬小于文獻的帶寬，主要是由于0．6 μm CMOS工藝限制。文中模擬乘法器的功耗要小于文獻，并不需要額外的偏置電路，設計方便。

4 結束語
采用動態閾值NMOS晶體管作為兩路輸入信號的輸入晶體管，采用4個動態閾值NMOS和2個有源電阻實現了一種低壓低功耗CMOS模擬乘法器電路，節省了輸入晶體管數目，節省了偏置晶體管和偏置電路，實現低壓低功耗的目的。基于CSMC 0．6 μm DPDM CMOS工藝，1．2 V模擬乘法器的輸入信號VinA的頻率為5 MHz，信號峰峰值為1．0 V，而輸入信號VinB的頻率為100 MHz，信號峰峰值為0．5 V，則輸出信號Vout的峰峰值為0．35 V，一次諧波和三次諧波的差值為40 dB。1．2 V模擬乘法器輸出信號的頻帶寬度為375 MHz，平均電源電流約為30 μA，即動態功耗約為36μW，能直接應用于低功耗通信集成電路的設計。

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關鍵詞： 動態閾值 模擬乘法器

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